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详细教程：vivado2019.2 & vitis2019.2下，zynq7000系列FPGA固化PL程序到外挂flash和SD卡
详细教程：vivado2019.2 & vitis2019.2下，zynq7000系列FPGA固化PL程序到外挂flash和SD卡 0.简介 xilinx的zynq系列FPGA既包含了传统的FPGA部分，又嵌入了arm的硬核，分别称为PL（Programmable Logic）和PS (Processing System)。PL部分以前在ISE，现在在vivado上编程配置，包括通用的组合逻zynq7000 传统方式制作系统镜像
zynq7000 传统方式制作系统镜像 传统方式制作系统镜像，主要是以下几个步骤: 配置zynq芯片ubootkerneldevice-treerootfs打包制作BOOT.BIN和image.ub 环境配置 系统centos7 安装xilinx的vivado、SDK软件 安装**gcc make g++**等基本编译环境 从xilinx的github上下载交叉编译工ZYNQ7000 FSBL加载启动代码详解
参考资料： https://blog.csdn.net/zhaoxinfan/article/details/54958641 https://blog.csdn.net/asmartkiller/article/details/84072643 https://blog.csdn.net/qq_40155300/article/details/89001808 SDK版本：2017.4 写在前面： 该文档不足以使你清楚FSBL启动的寄存器级的操作细ZYNQ7000 学习（二十六）使用 VIVADO 例化 BRAM 实现VGA 缓存驱动
使用 VIVADO 例化 BRAM 实现VGA 缓存驱动 学习内容 本节课程的实现目标仍为 VGA 显示，但是与第 25课的不同 之处 在于，本 节将例化 VIVADO 中的 BRAM 实现缓存 ，分辨率 仍为 640*480，时序 驱动文 件 不做 改动。 实现步骤 本节课程 将在第 25课工程 基础上进行修改。下 图 为 第ZYNQ7000学习（十七）多路 PWM 原理分析以及实现试验
多路 PWM 原理分析以及实现试验 基本原理(参考 http͗//www͘fpga4fun͘com/PWM_D_C͘html) PWM_(Pulse_Width_Modulation) A PWM takes an input value of any width and creates an output that is just one-bit wide. PWM using a free-running counter That’s the simplZYNQ7000学习（十一）VIVADO下的逻辑仿真试验
视频十一：VIVADO下的逻辑仿真试验 1.首先建立硬件约束文件： 设计代码：（在右边编辑） module decoder38( input [2:0] SW, output [7:0]LED ); assign LED = 1 << SW ; endmodule 片 再加约束： 这个里面增加约束（约束文件以前有）； 再增加基定 文件 在上面FPGA系统性学习笔记连载_Day4 Xilinx ZYNQ7000系列 PS、PL、AXI 、启动流程基本概念篇
FPGA系统性学习笔记连载_Day4 Xilinx ZYNQ7000系列 PS、PL、AXI 、启动流程基本概念篇 连载《叁芯智能fpga设计与研发-第4天》 【xilinx ZYNQ7000系列 PS、PL、PS-PL 、AXI 、启动流程 基本概念】 原创作者：紫枫术河 转载请联系群主授权，否则追究责任 这篇文章记录《xil