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锁相环(倍频,分频,利用开发板固有频率+内部专用电路 产生特定需求的时钟信号)
一般来说,开发板的时钟是由板上的晶振产生的,频率大部分是固定的,但是我们在应用中有时候需要其他频率的时钟信号。为了解决这个问题,FPGA内部会留有专门的设置电路——时钟管理单元(硬件资源),利用已有的时钟信号来产生其他的时钟信号。 比如晶振50MHz,我们需要125MHz的时钟信号,锁相环(倍频,分频,利用开发板固有频率+内部专用电路 产生特定需求的时钟信号)
一般来说,开发板的时钟是由板上的晶振产生的,频率大部分是固定的,但是我们在应用中有时候需要其他频率的时钟信号。为了解决这个问题,FPGA内部会留有专门的设置电路——时钟管理单元(硬件资源),利用已有的时钟信号来产生其他的时钟信号。 比如晶振50MHz,我们需要125MHz的时钟信号,