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cpu乱序执行的问题
因为CPU的执行速度会比内存快百倍 当CPU执行第一个指令的时候会等待内存返回的结果在进行计算 但是这期间的时间不能一直阻塞在这里 那么 CPU就会分析后面的指令 如果后面的指令跟上面指令没有直接依赖关系 那就运行后面的指令 CPU为了提高指令的执行效率 就会出现乱序的问题全网最详细的Intel CPU体系结构分析(内核源码)
前段meldown漏洞事件的影响，那段时间也正好在读Paul的论文关于内存屏障的知识，其中有诸多细节想不通，便陷入无尽的煎熬和冥想中，看了《计算机系统结构》、《深入理解计算机系统》、《大话处理器》等经典书籍，也在google上搜了一大堆资料，前前后后、断断续续地折腾了一个多月，终于想通全网最详细的Intel CPU体系结构分析(内核源码)
前段meldown漏洞事件的影响，那段时间也正好在读Paul的论文关于内存屏障的知识，其中有诸多细节想不通，便陷入无尽的煎熬和冥想中，看了《计算机系统结构》、《深入理解计算机系统》、《大话处理器》等经典书籍，也在google上搜了一大堆资料，前前后后、断断续续地折腾了一个多月，终于想通JMM内存模型
JMM是一种规范， 目的是解决由于多线程通过共享内存进行通信时，存在的本地内存数据不一致、 编 译器会对代码指令重排序、处理器会对代码乱序执行等带来的问题。 目的是保证并发编程场景中的原子性、可见性和有序 性。并发编程：乱序执行的那些事儿五分钟给你整明白
什么是乱序执行 乱序执行 [1] ，简单说就是程序里面的代码的执行顺序，有可能会被编译器、CPU 根据某种策略调整顺序（俗称，“打乱”）——虽然从单线程的角度看，乱序执行不影响执行结果。 为什么需要乱序执行 主要原因是 CPU 内部采用 流水线技术 [2] 。抽象且简化地看，一个 CPU 指令的执Java开发者必看避坑指南！面试题分享
二、解析 ? 1. 硬件层的并发优化基础知识 ? ?存储器的层次结构图如下： ??? ? ?各级缓存耗时对比： ??? ? ?采用分层缓存的层次结构会带来数据不一致问题，如下图： ??? ? ?那么如何保证数据的一致性，现代CPU处理办法有两种： ? ?(1) 锁系统总线； ? (2) 利用缓存一致性协议MESI(Intel处理器用Java面试题
1.说说你对volatile的理解。 volatitle在多线程情况下，可以保证数据数据的可见性。禁止指令重排优化，从而避免多线程环境下程序出现乱序执行导致执行结果不一致的问题，它不支持原子性(使用AutomicInteger来保证原子性)。 2.你在哪些地方使用过volatitle在单例模式DCL中使用过。cpu 乱序执行与问题【转】
转自：https://blog.csdn.net/lizhihaoweiwei/article/details/50562732 版权声明：本文为博主原创文章，遵循 CC 4.0 BY-SA 版权协议，转载请附上原文出处链接和本声明。本文链接：https://blog.csdn.net/lizhihaoweiwei/article/details/50562732“CPU执行乱序”是一个常见的话题，鉴于自己深入浅出计算机组成原理：冒险和预测（三）：CPU里的“线程池”（第24讲）
一 、引子 过去两讲，我为你讲解了通过增加资源、停顿等待以及主动转发数据的方式，来解决结构冒险和数据冒险问题。对于结构冒险，由于限制来自于同一时钟周期不同的指令，要访问相同的硬件资源，解决方案是增加资源。对于数据冒险，由于限制来自于数据之间的各种依赖，我们可以提前把数据转发