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Xilinx zynq vivado工程搭建

作者:互联网

方法

新建工程,一路默认到选择器件,这里根据项目选择自己的芯片,
186
新建Block Design,
187
添加IP,
188
这里先添加zynq,
189
点击Run Block Automation,
190
双击zynq的图标,配置CPU和外设,首先是时钟,我的是33.33MHz,FCLK是PS提供给PL用的时钟,
在这里插入图片描述
配置DDR,这里只配了Memory Part参数,我们假定PCB Layout是完美的,
192
配置外设,
193
点击OK,确定,创建顶层文件,
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点击Run Synthesis,进入Synthesis Design,添加约束,编译即可。

标签:Run,vivado,点击,添加,zynq,Xilinx,Design,Synthesis
来源: https://blog.csdn.net/Zhu_Zhu_2009/article/details/99940042