计组 | 2017年 408计算机统考 计算机组成原理 真题解析
作者：互联网
答案：C
解析： CPU执行时间 T = 指令数 x CPI / 主频
CPI:执行一条指令所需时钟周期数
主频:时钟周期的倒数。
答案：
解析：第二个周期读取体号4，5，6，7，第三个周期读取体号8。
有4个体，则体号占2位。要把发送周期分为4个。
804 001A 低位体号 A 写为 1010 ，最低位为 10 即 2 ，则体号从2号开始。(算这个好像也没用)
交叉编址分为高位交叉编址和地位交叉编址，每次读写32位，所以是低位交叉编址。
低位交叉编址方式下，总是把高位体内地址送入由低位体号确定的模块内进行译码。
double型变量长64b。
答案：A
解析：
时间局部性：—旦某—条指令执行，不久的将来还会再次执行;
空间局部性：一旦一个指令一个存储单元被访问，那么它附近的单元也将很快被访问。
答案：D
解析：
相对寻址：程序计数器PC的内容加上指令格式中的形式地址A而形成操作数的有效地址，即EA=(PC) +A,广泛应用于转移指令。
基址寻址：与上类似，使用的是基址寄存器BR的内容，即EA=(BR)+A，面向操作系统的，由操作系统和管理程序确定。例如虚拟存储管理的页式、段式、段页式。
变址寻址：与上类似，使用的是变址寄存器X的内容，即EA= (IX)+A，面向用户，在执行程序过程中，lX中的内容可由用户改变（作为偏移量)。特别适合编址循环程序。
寄存器寻址：在指令字中直接给出操作数所在的寄存器的编号。即EA=R。
答案：A
解析：29条则至少5位op，2的5次方 = 32 ，则剩余3个空位留给二地址指令 。
又因为二地址指令 多出6位存放，则2的6次方 = 64 条 ，前面还有3个空位 ，64 x 3 =192 条
指令字长 = 5 + 3 x 6 = 23 位 ，为了取指令方便 ， 必须为 8 的整数倍。
答案：C
解析：
超标量流水线技术：每个时钟周期内可并发多条独立指令，即以并行操作方式将多条指令编译并执行。超标量计算机不能调整指令的执行顺序，但可以通过编译优化技术将可并行的执行的指令搭配起来( 打乱指令的排列顺序 )，挖掘更多的指令并行性。
答案：B
解析：
主存储器:即主存，在CPU外部，存储指令和数据，由RAM和ROM实现。
控制存储器:存放实现指令系统的所有微指令，是一种只读型存储器即ROM。
按内容访问的存储器是相联存储器。每个存储单元都有匹配电路。比如TLB块表。
答案：A
解析：
数据通路：数据在功能部件之间传送的路径称为数据通路。路径上的部件称为数据通路部件，如ALU，通用寄存器，状态寄存器，异常和终端处理逻辑等。数据通路由控制部件控制。
数字电路根据逻辑功能的不同特点，可以分成两大类，一类叫组合逻辑电路（简称组合电路），另一类叫做时序逻辑电路〈简称时序电路）。组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入，与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号，而且还取决于电路原来的状态，或者说，还与以前的输入有关。
时序系统：提供控制
时序逻辑电路：运算
答案：D
解析：
A.CPU--寄存器--cache--主存--磁盘 速度越来越慢
B.猝发传送：即给一个首地址，可以传输一段数据。
C.桥接器主要负责总线之间流量交换。
D.PCI—Express是一种通用的总线规格，它最早由Intel所提倡和推广（也既是之前3GIO)，它最终的设计自的是为了取代现有计算机系统内部的总线传输接口，这不只包括显示接口，还囊括了CPU、PCI、HDD、Network等多种应用接口。从而可以像Hyper—Transport一样，用以解决现今系统内数据传输出现的瓶颈问题，并且为未来的周边产品性能提升做好充分的准备。
以往计算机系统的各种设备共用一个带宽，采用了并行互联，这大大影响了系统整体的性能表现，同时并行信号由于相互干扰也严重制约了且后速度的进一步提升。
而PCI—E则采用了单行互联方式，以点对点的形式进行数据传输，每个设备可以单独的享用带宽，从而大大提高了传输速率，而且也为更高的频率提升创造了条件。
答案：D
解析：实现传输指令是CPU向IO端口传输，而CPU内部是通用寄存器，而IO设备为外部的。
I/O端口：是指接口电路中可被CPU直接访问的寄存器。
答案：B
解析：
CPU响应中断的时间是在每条指令执行阶段的结束时刻。
中断请求是指中断源向CPU发送中断请求信号。中断请求寄存器保存中断请求，等待CPU的处理。
在CPU运行程序时,每当CPU完成当前指令的执行,取出下一条指令之前﹐就会通过采样中断请求信号线来自动查看有无中断请求信号。
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